SynaptiCAD Product Suite v17.01p LINUX 英文正式版(電子設計自動化軟體)
安裝序號:
序號產生器放至於keygen夾內
內容說明:
SynaptiCAD公司出品的EDA（電子設計自動化）工具集合，包括HDL輸入、仿真、測試、
波形分析、管腳映射工具等等,是一個很完整的EDA方案。
包含了9種功能強大的工具：TestBencher Pro；BugHunter Pro；VeriLogger Pro；
WaveFormer Pro；SimuTAG；PinPort；DataSheet Pro；Timing Diagrammer Pro；
Gigawave Viewer 。
1.TestBencher Pro：用於從獨立於語言的時序邏輯表生成交互式VHDL,Verilog,
OpenVera,e, 和TestBuilder 測試基準及總線功能的模型。生成的測試基準能提供基
於仿真相應的不同的激發向量，以便於測試基準功能作為一個被測試系統環境的動作
模型正常工作。 TestBencher Pro是一個優秀的測試大規模FPGA 和 ASIC設計的工具。
2.BugHunter Pro：一款用於Verilog， VHDL 和 C++ 模擬器的圖形調試系統。
BugHunter 支援所有主要的 HDL 模擬器，其主要功能包括：單一步驟調試、波形數
據串流、項目管理等等。可以偵測程式與幫助系統的交互過程從而發現問題所在。
3.VeriLogger Pro：Verilog模擬器軟體。提供一個綜合了傳統Verilog模擬器所有
特徵的仿真環境，它具有強大的圖形測試向量產生器。VeriLogger 的快速模型測試
使用戶可以對設計中的每個模型進行「自底向上」的測試。
4.WaveFormer Pro：由時序圖分析器、模擬器和測試向量生成器組合而成。它為設計
人員提供了一個集成的環境，可以用來開發數字和模擬線路的時序圖。 WaveFormer
Pro可以由Spice模擬器，Mathematica，或Matlab等工具輸入模擬數據。還可以利用
WaveFormer Pro 內部擁有的波形函數直接生成模擬信號；或者將從總線上得到的數
字信號變換成模擬信號。還可以將模擬信號波形逐段線性地變換成Spice模擬器的電
壓信號源。
5.SimuTAG：一款功能強大和實時地查證出 FPGAs 的錯誤的系統。可經由比較FPGA
功能規則反證RTL樣式模擬規則，迅速發現邏輯和綜合錯誤。
6.PinPort：提供數字硬體與Verilog 或C++的虛擬介面環境。
7.DataSheet Pro：時間表文件夾管理工具。
8.Timing Diagrammer Pro：時間表設計工具。
9.Gigawave Viewer：波形觀測器。
英文說明:
AutoStitch is the world's first fully automatic 2D image stitcher.
Capable of stitching full view panoramas without any user input whatsoever,
AutoStitch is a breakthrough technology for panoramic photography, VR
and visualisation applications. AutoStitch is built using cutting edge
research from the AI lab at UBC, but it's incredibly simple to use!
Just select a set of photos, and AutoStitch does the rest: digital photos
in, panoramas out.
圖片說明:
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